| 000 | 02145nam a22003257a 4500 | ||
|---|---|---|---|
| 999 |
_c63280 _d63280 |
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| 005 | 20251202110942.0 | ||
| 008 | 250605b cx ||||| |||| 00| 0 spa d | ||
| 020 | _a9789587786743 | ||
| 040 |
_aUNAMBA _bspa _cBiblioteca Especializada EAP Ingeniería de Informática y Sistemas _erda |
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| 041 | _aspa | ||
| 082 |
_a621.395 _bV35 2020 _d01 |
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| 100 |
_aVázquez del Real, Javier _eAutor |
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| 245 |
_aCircuitos Lógicos Digitales: _bdel diseño al experimento / _cJavier Vázquez del Real _hImpreso |
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| 250 | _aSegunda edición | ||
| 264 |
_aBogotá - Colombia _b Alpha Editorial _c2020 |
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| 300 |
_a384 páginas _b:ilustraciones gráficos byn, cuadros _c; 17 x 24 centímetros |
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| 500 | _aIncluye datos curriculares del autor | ||
| 505 | _aParte 1 Familias lógicas -- Puertas lógicas TTL -- Puertas lógicas CMOS -- Parte 2.- Lógica combinacional -- Decodificador binario básico de 2 a 4 -- Síntesis óptima de circuitos combinacionales -- Sumador completo, generador de paridad y conversores de código -- Decodificador binario de 2 a 4 con control de polaridad -- Diseño lógico con el multiplexor 74 x 151-- Unidad aritmética de cuatro bits con el 74 x 283 Parte 3.- Lógico secuencial -- Generación de señal de reloj con circuitos astables -- Con tador módulo 8 con el 74 x 90 -- Segundero con contadores modulares -- Generador de números seudoaleatorios -- Autómatas de estados finitos de Mealy y de Moore -- Biestables asíncronos -- Divisor de frecuencia asíncrono. | ||
| 520 | _aEste texto contiene casos de estudio sobre diseño lógico digital que se expone paso a paso en capítulos individuales elaborados a modos de sesiones prácticas. | ||
| 526 | _5Sala especializada EAP Ingeniería Informática y sistemas | ||
| 546 | _aTexto en español | ||
| 650 | 0 |
_aDISEÑO LÓGICO _917182 |
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| 650 | 0 |
_aCIRCUITOS LÓGICOS _93104 |
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| 900 | _bLIB | ||
| 910 |
_aDoris B. Paniura Huamán _b10/06/2025 |
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| 942 |
_2ddc _a109207BEIISC _cLIB |
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